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Engenharia Elétrica ·
Sistemas Digitais
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1 s x z x z q z y z y x y z s r q q 2 s R CLK q q 3 ENABLE ES CK CLR Q0 PR Q1 PR Q2 PR Q3 PR Q4 PR Q0 PR Q1 PR Q2 PR Q3 PR Q4 PR D1 PR Q1 D2 PR Q2 D3 PR Q3 D4 PR Q4 CLR Q0 CLR Q1 CLR Q2 CLR Q3 CLR Q4 Ck CLR ES q3 q2 q1 q0 Jo D1 Ko D1 Construção do circuito 7 Entrada B bit sendo transmitido Saidas S1S0 00 Não detectado 01 K 10 Z 11 W Estados Inicio K Z W Z ou W 4 3 e 1 11 01 e e e e 0 e e e 10 e e e 2 7 5 6 4 3 0 1 E Q1 Q0 Q1 Q0 JK JK JK 111 101 100 000 000 000 101 101 100 001 101 001 101 101 101 101 101 101 101 101 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 x 1 x 0 x 1 x 0 x 1 x 1 x 1 x 1 x 1 x 1 x 0 J1 k1 J0 k0 J1 1 k1 1 J0 E0 E0 E0 k0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 E0 Diagrama Inicio 00 K 01 Z ou W 00 W 11 Z 10 Tabela B Q2 Q1 Q0 D2 D1 D0 S1 S0 0 0 0 0 0 0 1 0 0 1 1 1 0 0 0 0 1 0 0 0 2 1 0 0 1 0 1 0 0 1 3 0 1 0 0 1 0 0 0 0 11 1 0 1 1 0 1 1 0 0 4 0 1 0 0 0 1 1 1 1 12 1 0 0 0 1 0 1 1 1 D2 BD0 D1 BD1D0 BD1 BD0 D0 B 5 Contador Johnson D2 D1 D0 0 0 0 1 0 0 1 1 0 1 1 1 0 1 1 0 0 0 1 Tabela de Transição de estados D2 D1 D0 Q2 Q1 Q0 JK Jk J0 k0 0 0 0 0 1 0 0 1 x 0 x 0 x 4 1 0 0 1 1 0 x 0 1 x 0 x 6 1 1 0 1 1 1 x 0 0 1 x 7 1 1 1 0 1 1 x 1 x 0 x 3 0 1 1 0 0 1 0 x x 1 x 1 0 0 1 0 0 0 0 x 0 x 1 Expressões J2 K2 J1 K1 J2 0 K2 0 J1 0 K1 0 S1 D1D0 D1 S0 D1D0 D2 8 Entradas T1 T2 T3 t nível máximo Saidas B1 B2 t acionada Estados T1 00 T1 não cheio T1 10 T1 cheio T2 11 T2 cheio T3 00 T3 cheio Diagrama Tabela T1 T2 T3 D1 D0 2 2 B1 B2 0 x x 0 0 0 0 1 x x 0 1 0 0 0 x 0 x 0 1 0 1 0 x 1 x 0 1 1 0 x x 0 1 1 1 x x 1 1 1 1 x x 1 1 0 0 x x 0 1 0 0 0 x x 0 0 0 0 9 A B 0 y 0 1 y 0 A B A B A B A B 3 y 1 2 y 0 A B A B A B 10 S0 0 ϬϬ S1 λ1 2 λ1 T10 e S1 0Ϭ0 S0 ou T11 S1 α T11 3 λ1 S0 α T10 011 5 λ0 S0 e T10 T21 4 λ1 S0 e T10 100 101
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